Hardware-Entwurf mit VHDL

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Hardware-Entwurf mit VHDL Prof. Dr.-Ing. Stefan Wolter Elektrotechnik und Informatik • Arithmetische Operatoren: Operator Funktion Typ linker Operand Typ rechter Operand Typ Ergebnis * / Multiplikation Division jeder ganzzahlige Typ jeder Fließkommatyp jeder physikalische Typ jeder physikalische Typ INTEGER REAL jeder ganzzahlige Typ jeder Fließkommatyp jeder physikalische Typ jeder physikalische Typ jeder physikalische Typ wie links wie links INTEGER REAL jeder physikalische Typ jeder physikalische Typ wie links wie links INTEGER REAL wie links Tabelle 2.8: Arithmetische Operatoren wie linker Operand wie linker Operand wie linker Operand wie linker Operand wie rechter Operand wie rechter Operand wie linker Operand wie linker Operand wie linker Operand wie linker Operand INTEGER MOD Modulo jeder ganzzahlige Typ wie links wie linker Operand REM Remainder jeder ganzzahlige Typ wie links wie linker Operand + pos. Vorzeichen - neg. Vorzeichen - jeder numerische Typ wie Operand - jeder numerische Typ wie Operand + Addition jeder numerische Typ wie links wie linker Operand - Subtraktion jeder numerische Typ wie links wie linker Operand & Verkettung jeder Vektortyp jeder Vektortyp Element vom Typ wie Vektor rechts jeder Elementetyp Vektor vom gleichen Typ wie links Element vom Typ wie Vektor links jeder Vektortyp gleicher Typ wie links gleicher Typ von Vektor wie links gleicher Typ von Vektor wie links gleicher Typ von Vektor wie rechts gleicher Typ wie links VHDL-GRUNDLAGEN 47
Hardware-Entwurf mit VHDL Prof. Dr.-Ing. Stefan Wolter Elektrotechnik und Informatik Beispiel: Anwendung des Verkettungsoperators SIGNAL x, y : bit_vector (7 DOWNTO 0); SIGNAL half_byte_1, half_byte_2 : bit_vector (3 DOWNTO 0); SIGNAL a, b, c, d : bit; ... half_byte_1
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