Schaltungsdesign mit VHDL

4 Aufbau eines VHDL-Modells
d.h. die einzelnen Funktionen laufen nicht immer nacheinander, sondern
eventuell auch gleichzeitig ab.
Um diese Eigenschaft zu beschreiben, wird das Konzept der parallelen
(nebenläufigen, oder auch "concurrent") Anweisungen verwendet, die
im Idealfall gleichzeitig bearbeitet werden. Da die Simulation eines
VHDL-Modells in der Regel jedoch auf einem Prozessor abläuft, ist
dies nicht möglich. Deshalb wurde ein spezieller Simulationsalgorithmus
entwickelt, der ein "quasi paralleles", d.h. für den Benutzer nicht
direkt sichtbares, sequentielles Abarbeiten der nebenläufigen Befehle
gestattet. Dieser Ablauf wird in Kapitel 8 erläutert.
Aus oben genanntem Grund sind die VHDL-Anweisungen in zwei
Kategorien einzuteilen: sequentielle und nebenläufige Anweisungen.
Innerhalb des Anweisungsteils einer Architektur sind alle Sprachkonstrukte
nebenläufig. Nebenläufige Anweisungen sind z.B. die Instantiierung
von Komponenten, die BLOCK- und GENERATE-Anweisungen
sowie insbesondere auch sämtliche Prozesse:
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