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Etude de la fiabilité porteurs chauds et des performances des ...

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tel-00117263, version 2 - 29 Jan 2007<br />

Chemin <strong>de</strong><br />

conduction<br />

Grille métallique<br />

Substrat<br />

Chapitre III<br />

FIG. III.4 – Création d’un chemin <strong>de</strong> conduction par les pièges <strong>de</strong> charge, concept <strong>de</strong> perco<strong>la</strong>-<br />

tion<br />

doivent être maintenues les plus basses possibles par <strong>la</strong> maîtrise <strong>de</strong>s étapes <strong>de</strong> fabrication, en<br />

particulier une préparation adéquate du substrat, mais aussi par le contrôle <strong>de</strong> <strong>la</strong> pré-oxydation<br />

[19]. Les risques <strong>de</strong> BD extrinsèques <strong>et</strong> intrinsèques <strong>de</strong>s diélectriques <strong>de</strong> Grille peuvent être<br />

réduits pour les oxy<strong>de</strong>s minces (Tox < 10nm) par un processus d’empilement d’oxy<strong>de</strong> [19].<br />

Dans ce procédé, un film d’oxy<strong>de</strong> est déposé en phase vapeur (CVD) est empilé sur l’oxy<strong>de</strong><br />

thermique. Les avantages <strong>de</strong> ce processus vis à vis d’un processus thermique c<strong>la</strong>ssique sont :<br />

• <strong>la</strong> probabilité pour que les défauts soient alignés (<strong>et</strong> donc <strong>la</strong> probabilité <strong>de</strong> formation d’un<br />

chemin <strong>de</strong> conduction) est inférieure,<br />

• l’oxy<strong>de</strong> contient peu <strong>de</strong> défauts provenant du substrat puisque moins <strong>de</strong> silicium y est<br />

consommé.<br />

(1)<br />

Gate<br />

SiO 2<br />

Thick oxi<strong>de</strong><br />

Transient dominant<br />

Substrate<br />

(1) traps with energy re<strong>la</strong>xation<br />

(2) trap-assisted valence-electron<br />

(3) Locally thinned oxi<strong>de</strong> due to<br />

conductive fi<strong>la</strong>ment<br />

(1)<br />

(2)<br />

Gate<br />

SiO2 SiO2<br />

Thin oxi<strong>de</strong><br />

Steady-state<br />

dominant<br />

Substrate<br />

(3)<br />

Gate<br />

Substrate<br />

FIG. III.5 – Représentation schématique <strong>de</strong>s mécanismes <strong>de</strong> conduction tunnel assistée par<br />

pièges responsables du SILC.<br />

115

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