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Acceso al documento en PDF - Biblioteca Nacional de Maestros

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capacitores <strong>de</strong> carga <strong>de</strong> s<strong>al</strong>ida. Ambos términos son necesarios para c<strong>al</strong>cular la pot<strong>en</strong>cia y<br />

<strong>de</strong>p<strong>en</strong>di<strong>en</strong>do <strong>de</strong> la carga uno prev<strong>al</strong>ecerá sobre el otro. La velocidad es un factor también<br />

<strong>de</strong>cisivo <strong>en</strong> la pot<strong>en</strong>cia ya que la com<strong>en</strong>te <strong>de</strong> carga y <strong>de</strong>scarga <strong>de</strong>p<strong>en</strong><strong>de</strong>, <strong>en</strong>tre otras cosas, <strong>de</strong> los<br />

tiempos <strong>de</strong> subida y bajada. Existe una relación proporcion<strong>al</strong> <strong>en</strong>tre la máxima frecu<strong>en</strong>cia <strong>de</strong><br />

trabajo y la pot<strong>en</strong>cia disipada.<br />

Consi<strong>de</strong>raciones <strong>de</strong> marg<strong>en</strong> <strong>de</strong> ruido: existe un compromiso <strong>en</strong>tre marg<strong>en</strong> <strong>de</strong> ruido y velocidad.<br />

Se ev<strong>al</strong>uaron con simulaciones SPICE diversas configuraciones para mejorar los márg<strong>en</strong>es <strong>de</strong><br />

ruido <strong>en</strong> los bloques <strong>de</strong> la PLA.<br />

2.6.4. G<strong>en</strong>erador <strong>de</strong> PLA.<br />

Para la g<strong>en</strong>eración <strong>de</strong> la PLA se utilizó lógica pseudo-nMOS <strong>en</strong> una configuración <strong>de</strong>l tipo<br />

NOR-NOR. Entre las princip<strong>al</strong>es v<strong>en</strong>tajas figuran la gran velocidad, el gran fan-in <strong>de</strong> las compuestas<br />

NOR y la minimización <strong>de</strong> la cantidad <strong>de</strong> transistores empleados. Una <strong>de</strong>sv<strong>en</strong>taja <strong>de</strong> esta lógica es el<br />

consumo <strong>de</strong> pot<strong>en</strong>cia.<br />

Diversos tipos <strong>de</strong> PLA pre<strong>de</strong>finidos son consi<strong>de</strong>rados <strong>de</strong> acuerdo a las restricciones<br />

impuestas con la cantidad <strong>de</strong> <strong>en</strong>tradas y la cantidad <strong>de</strong> minitérminos a g<strong>en</strong>erar. La cantidad <strong>de</strong><br />

<strong>en</strong>tradas va a afectar a los caminos <strong>de</strong> met<strong>al</strong>ización que transportan a Vdd y Vss. La cantidad <strong>de</strong><br />

minitérminos afectará a la geometría <strong>de</strong> los p-MOS <strong>de</strong> pull-up y <strong>en</strong> caso <strong>de</strong> ser necesario se<br />

agregarán etapas <strong>en</strong> cascadas para po<strong>de</strong>r manejar mayor capacidad <strong>de</strong> carga.<br />

2.65 G<strong>en</strong>erador <strong>de</strong> Flip-Flops.<br />

Se g<strong>en</strong>eraron tres grupos que implem<strong>en</strong>tan los sigui<strong>en</strong>tes flip-flops: D, JK y T. La cantidad y<br />

tipo <strong>de</strong> flip-flops a emplear es conocida una vez efectuada la síntesis secu<strong>en</strong>ci<strong>al</strong>. Por lo tanto, es<br />

tarea <strong>de</strong>l G<strong>en</strong>erador <strong>de</strong> Flip-Flops efectuar la compilación <strong>de</strong> los grupos necesarios que Conformarán<br />

el conjunto <strong>de</strong> flip-flops a utilizar <strong>en</strong> el diseño e informar <strong>al</strong> g<strong>en</strong>erador <strong>de</strong> Ubicación y Ruteo sobre la<br />

forma <strong>de</strong> conexión <strong>de</strong> los mismos.<br />

2.6.6. G<strong>en</strong>erador <strong>de</strong> Ubicación y Ruteo.<br />

Una vez <strong>de</strong>sarrollada la PAL y los Flip-Flops, la sigui<strong>en</strong>te tarea consiste <strong>en</strong> .<strong>de</strong>scribir la<br />

posición <strong>de</strong> cada grupo y sus conexiones para que el ruteador se <strong>en</strong>cargue <strong>de</strong> unir todos los grupos.-.<br />

Al igu<strong>al</strong> que los bloques, la ubicación <strong>de</strong> cada grupo es pre<strong>de</strong>finida. La única tarea a re<strong>al</strong>izar<br />

por este g<strong>en</strong>erador consiste <strong>en</strong> crear un archivo con los v<strong>al</strong>ores <strong>de</strong> largo y ancho obt<strong>en</strong>idos para cada<br />

grupo y con toda la distribución ya <strong>de</strong>finida.<br />

El g<strong>en</strong>erador toma los archivos <strong>de</strong> perfil creados por los g<strong>en</strong>eradores <strong>de</strong> PAL y flip flops y<br />

traduce esta información para que pueda ser interpretada posteriorm<strong>en</strong>te por el Ruteador.<br />

Recor<strong>de</strong>mos que la tarea fundam<strong>en</strong>t<strong>al</strong> está dada por el Ruteador y que este g<strong>en</strong>erador Simplem<strong>en</strong>te<br />

traduce la información.<br />

3. Conclusiones.<br />

Implem<strong>en</strong>tar un CAD que cubra todos los pasos necesarios para el <strong>de</strong>sarrollo <strong>de</strong> un sistema<br />

secu<strong>en</strong>ci<strong>al</strong> es una tarea ardua.<br />

Más aún, <strong>de</strong>sarrollarlo como sistema abierto <strong>de</strong> forma t<strong>al</strong> que sea posible expandirlo o<br />

modificarlo <strong>en</strong> cada uno <strong>de</strong> los princip<strong>al</strong>es <strong>al</strong>goritmos es una tarea <strong>de</strong> precisión.<br />

Y si a<strong>de</strong>más le agregamos la opción <strong>de</strong> transportarlo <strong>en</strong>tre distintas plataformas <strong>de</strong> sistemas<br />

operativos, le estamos dando a este paquete <strong>de</strong> software un pot<strong>en</strong>ci<strong>al</strong> por <strong>de</strong>más interesante.<br />

Nuevas i<strong>de</strong>as y mezclas <strong>de</strong> tecnologías <strong>de</strong> otras áreas, unidas con técnicas bi<strong>en</strong> conocidas y<br />

tradicion<strong>al</strong>es, hac<strong>en</strong> <strong>de</strong> nuestro CAD una herrami<strong>en</strong>ta muy útil a la hora <strong>de</strong> implem<strong>en</strong>tar diseños<br />

secu<strong>en</strong>ci<strong>al</strong>es.<br />

P<strong>en</strong>sando <strong>en</strong> el futuro, el compilador <strong>de</strong> sicilio insertado d<strong>en</strong>tro <strong>de</strong> este proyecto, permitirá<br />

hacer otros tipos <strong>de</strong> <strong>de</strong>sarrollos con nuevas tecnologías.<br />

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