Une Boite `a Outils Pour la Preuve Formelle de Syst`emes Séquentiels
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3.4. MINIMISATION DE MACHINES SÉQUENTIELLES 79<br />
De cette façon, on réécrit les équations données précé<strong>de</strong>mment en :<br />
EX = Pre( ⃗ f,Cns,F) (3.12)<br />
AX = ¬Pre( ⃗ f,Cns,¬F) (3.13)<br />
E 0 = G, et (3.14)<br />
E k+1 = λ⃗y.(E k (⃗y)∨(F(⃗y)∧Pre( ⃗ f,Cns,E k )(⃗y))). (3.15)<br />
A 0 = G, et (3.16)<br />
A k+1 (⃗y) = λ⃗y.(A k (⃗y)∨(F(⃗y)∧¬Pre( ⃗ f,Cns,A k )(⃗y))) (3.17)<br />
D’unpoint<strong>de</strong>vuecalcu<strong>la</strong>toire, ce<strong>la</strong>signifiequeces5caspeuventêtretraitésenutilisantles<br />
opérateurs booléens usuels (¬,∨,∧,...), <strong>de</strong> complexité polynomiale sur les DAGs, plus le<br />
calcul <strong>de</strong> <strong>la</strong> fonction Pre. Le coût global <strong>de</strong> <strong>la</strong> validation d’une formule temporelle sur une<br />
machine séquentielle dépend donc du calcul <strong>de</strong> Pre. Nous étudierons dans le Chapitre 5<br />
<strong>la</strong> complexité <strong>de</strong> cette opération, et nous montrerons qu’elle est non polynomiale. Nous<br />
proposerons alors plusieurs techniques d’évaluation <strong>de</strong> Pre.<br />
3.4 Minimisation <strong>de</strong> machines séquentielles<br />
Ladifficulté<strong>de</strong><strong>la</strong>synthèse<strong>de</strong>matérielàpartird’une<strong>de</strong>scriptionfonctionelled’unemachine<br />
vient <strong>de</strong> ce que ce problème recouvre simultanément plusieurs problèmes d’optimisation<br />
souvent contradictoires. On doit synthétiser un circuit <strong>de</strong> taille aussi petite que possible,<br />
il faut donc diminuer le nombre <strong>de</strong> portes logiques et s’attacher à ce que l’assemb<strong>la</strong>ge<br />
<strong>de</strong> celles-ci occupe une surface minimale. Le circuit doit être suffisament rapi<strong>de</strong>, il faut<br />
donc que les connexions soient les plus courtes possibles, et que <strong>la</strong> profon<strong>de</strong>ur du circuit<br />
(nombre maximal <strong>de</strong> portes logiques entre les entrées et les sorties) soit <strong>la</strong> plus faible<br />
possible. Il y a <strong>de</strong>s contraintes électriques et <strong>de</strong> consommation, il faut donc que le nombre<br />
<strong>de</strong>connexionsàl’entréed’uneporte(fan-in)etàsasortie(fan-out)respectent<strong>de</strong>sloisbien<br />
précises. Si l’implémentation du circuit se fait sur un PLA (Programable Logic Array),<br />
fournissant <strong>de</strong>s portes et connexions prédéfinies (à charge <strong>de</strong> l’utilisateur <strong>de</strong> construire le<br />
circuit en ajoutant ou coupant certaines connexions), il faut aussi tenir compte du cadre<br />
non modifiable <strong>de</strong> cette structure pour l’optimisation <strong>de</strong>s divers critères cités.<br />
Cependant,unaspectàpeuprèscommunàtoutescesoptimisationsest<strong>la</strong>minimisation<br />
logique. Informellement, ceci pose <strong>la</strong> question <strong>de</strong> <strong>la</strong> “quantité” <strong>de</strong> logique (i.e. le nombre<br />
<strong>de</strong> portes) nécessaire pour implémenter une fonctionnalité donnée, éventuellement vectorielle<br />
et/ou séquentielle. Nous expliquons ici quelles sont les minimisations qui peuvent<br />
intervenirpourréduire<strong>la</strong>“complexité”(enterme<strong>de</strong>circuit, ouplusformellemententerme<br />
<strong>de</strong> complexité combinatoire et séquentielle au sens <strong>de</strong> [109]) d’une machine séquentielle.