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UNIVERSIDAD COMPLUTENSE DE MADRID

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Capítulo 4<br />

4.5.5 Referencias de tensión XFET<br />

Las referencias de tensión tipo Zener enterrado tenían el inconveniente de que la tensión<br />

mínima de funcionamiento era muy alta, pues era necesario que el diodo Zener entrase en<br />

ruptura. Este problema se solucionó en las referencias de tipo band-gap aunque hay que pagar un<br />

precio inesperado, puesto que el ruido en la salida es bastante alto en este tipo de referencias<br />

[Jun00].<br />

Fig. 4.45: Estructura interna de una referencia de tensión XFET [Jun00]. La tensión de pinch-off del transistor de canal p J 1 es 0.5<br />

V superior a la de J 2.<br />

Para solucionar este problema, Analog Devices desarrolló a mediados de los años 90 un<br />

nuevo tipo de referencias de tensión llamadas XFET, acrónimo de eXtra implantation jFET .<br />

Esta tecnología es propiedad de esta compañía y se caracteriza por que utiliza la tensión de<br />

pinch-off de un transistor JFET como referencia de tensión. La principal ventaja de estas<br />

estructuras es que los transistores JFET son dispositivos en los que el ruido es menor [Hor90]. El<br />

resto de componentes del amplificador operacional están construidos con transistores NPN y<br />

PNP verticales.<br />

4.5.5.1 Fundamento teórico de una referencia XFET<br />

Fig. 4.45 muestra la estructura típica de este tipo de referencias. Hay dos transistores JFET<br />

de canal p que se encuentran en zona lineal y cuyas tensiones de pinch-off difieren<br />

aproximadamente 500 mV. Para conseguirlo, se procedió a una implantación adicional de<br />

impurezas positivas en el canal p de uno de los transistores.<br />

Ambos transistores se encuentran polarizados por fuentes de corriente simétricas. Debido a<br />

la presencia del amplificador operacional, los drenadores de ambos transistores están a la misma<br />

tensión. Aceptando que los dos transistores están en zona lineal y aplicando (3.44b):<br />

I<br />

I = V − V · V<br />

(4.96)<br />

( )<br />

DSS1<br />

1 2<br />

VP1<br />

OUT P1 DS1<br />

I<br />

I = V − V · V<br />

(4.97)<br />

( )<br />

DSS 2<br />

2 2<br />

VP2<br />

A P2 DS2<br />

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