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UNIVERSIDAD COMPLUTENSE DE MADRID

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Capítulo 4<br />

V<br />

k<br />

V =− ∑ b ·2<br />

(4.115)<br />

n<br />

FB<br />

REF<br />

n<br />

2 k = 1<br />

k<br />

Formalmente, se puede decir que la salida de los conversores es proporcional al producto<br />

de un número y la tensión VREF. Por esta causa, estos conversores D/A se suelen llamar<br />

“multiplicadores” [Hor90]. Por otra parte, de (4.115) surge de forma natural una magnitud<br />

llamada “tensión del bit menos significativo”, VLSB cuyo valor es:<br />

VREF<br />

V LSB = (4.116)<br />

n<br />

2<br />

Esta tensión nos permite definir la “unidad del bit menos significativo” o ”unidad LSB” ,<br />

que es la más apropiada para medir la salida de un conversor D/A. Para expresar la salida de un<br />

conversor D/A en unidades LSB, basta con dividir la salida en voltios por VLSB.<br />

El amplificador operacional de fig. 4.50 puede ser interno, como en el modelo AD667 de<br />

Analog Devices, o externo, como en el caso de otros conversores como el modelo AD7541 de la<br />

misma compañía. En general, los conversores CMOS se diseñan para minimizar su tamaño por<br />

lo que no suele integrarse en ellos el amplificador operacional. En cambio, no es extraño<br />

encontrar el amplificador integrado en los conversores bipolares.<br />

4.6.2 Diseño de la etapa lógica de un conversor D/A<br />

En primer lugar, es imprescindible que en todo conversor D/A existan tantos conmutadores<br />

como entradas binarias tenga. La manera de construir los conmutadores depende de la tecnología<br />

empleada en la construcción del conversor. Fig. 4.52a-b muestran dos formas sencillas de<br />

construir conmutadores, uno en tecnología CMOS y otro en tecnología bipolar.<br />

En el conmutador CMOS, la entrada lógica excita un par de inversores colocados en serie<br />

[AleAD]. De esta manera, se puede mejorar el valor de la entrada digital, acercándola a los<br />

niveles lógicos exactos, y se obtiene su valor negado. Las salidas de los inversores atacan a las<br />

puertas de dos transistores NMOS. Normalmente, A1 y A2 están conectadas a tierra, bien sea real,<br />

bien sea virtual. Por tanto, en uno de ellos VGS = 0 y en el otro VGS = +VDD. Uno estará en zona<br />

de corte y otro en zona lineal, siendo imposible que ambos se encuentren simultáneamente en el<br />

mismo estado.<br />

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